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半导体器件基础--耗尽区 Depletion Zone


*半导体器件 - 耗尽区 Depletion Zone*

最初,当结型二极管形成时,载流子之间存在独特的相互作用。在 N 型材料中,电子很容易穿过结以填充 P 材料中的空穴。这种行为通常称为扩散。扩散是一种材料中载流子的高度积累和另一种材料中较低的聚集的结果。

一般来说,靠近结的载流子只参与扩散过程。离开 N 材料的电子会在其位置产生正离子。在进入 P 材料填充空穴时,这些电子会产生负离子。结果,结的每一侧都包含大量的正离子和负离子。

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这些空穴和电子耗尽的区域通常称为耗尽区。这是一个缺乏多数电流载体的领域。通常,在形成 PN 结时会形成耗尽区。下图显示了结型二极管的耗尽区。

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半导体器件基础- - 结二极管


*半导体器件 - 结二极管*

由 P 和 N 材料制成的晶体结构通常称为结型二极管。它通常被认为是一个双端设备。如下图所示,一个端子连接到 P 型材料,另一个连接到 N 型材料。

这些材料连接的公共键点称为。结型二极管允许载流子沿一个方向流动并阻止电流沿相反方向流动。

下图显示了结型二极管的晶体结构。看一下 P 型和 N 型材料相对于结的位置。晶体的结构从一端到另一端是连续的。连接点仅作为一个分离点,代表一种材料的结束和另一种材料的开始。这种结构允许电子在整个结构中彻底移动。

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下图显示了半导体物质在形成 PN 结之前的两部分。如指定的,材料的每个部分都有多数少数载流子

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每种材料中载流

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半导体器件基础--半导体的种类和掺杂


*半导体的种类*

当向半导体器件施加电压时,电子电流流向源极的正侧,空穴电流流向源极的负侧。这种情况只发生在半导体材料中。

硅和锗是最常见的半导体材料。一般来说,半导体的电导率介于金属和绝缘体的电导率之间。

锗作为半导体

以下是关于锗的一些要点-

  • 锗的最外层轨道有四个电子。在键中,原子仅显示其外部电子。
  • 锗原子将在共价键中共享价电子。如下图所示。锗是与共价键相关的那些。锗的结晶形式称为晶格。这种结构的原子排列方式如下图所示。
  • 在这种布置中,电子处于非常稳定的状态,因此不太适合与导体相关联。在纯态中,锗是一种绝缘材料,被称为本征半导体

下图显示了硅和锗的原子结构。

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硅作为半导体

半导体设

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半导体器件基础--电导率和迁移率


*电导率和迁移率*

如前所述,每个原子可能有一个或多个自由电子,它们在外加场的影响下一直穿过金属内部。

下图显示了金属内的电荷分布。它被称为金属的电子气描述

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散列区域代表带正电荷的原子核。蓝点代表原子外壳中的价电子。基本上,这些电子不属于任何特定的原子,因此,它们失去了个人身份并在原子间自由漫游。

当电子连续运动时,每次与重离子碰撞时,传输方向都会发生变化。这是基于金属的电子气理论。碰撞之间的平均距离称为平均自由程。在给定时间内,在金属中以相反方向通过单位面积的电子,在随机的基础上,使平均电流为零。

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半导体器件基础--固体材料中的传导


*固体材料中的传导*

原子外环中的电子数量仍然是导体和绝缘体之间差异的原因。众所周知,固体材料主要用于电子设备中以实现电子传导。这些材料可以分为导体、半导体和绝缘体。

然而,导体、半导体和绝缘体是通过能级图来区分的。此处将说明使电子离开其价带并进入传导所需的能量。该图是材料中所有原子的组合。绝缘体、半导体和导体的能级图如下图所示。

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价带

底部是价带。它代表最接近原子核的能级,价带中的能级保持平衡原子核正电荷所需的正确电子数。因此,这个带被称为填充带

在价带中,电子与原子核紧密结合。在能级中向上移动,电子在每个后续能级中与原子核的结合更加轻微。在靠近原子核的能级中干扰电子并不容易,因为它们的

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半导体器件基础--原子组合


简介

众所周知,原子核与特定原子的电子的距离是不相等的。通常,电子在明确定义的轨道上旋转。特定数量的电子只能通过外壳或轨道保持。原子的电导率主要受外壳电子的影响。这些电子与电导率有很大关系。

导体和绝缘体

导电是电子不规则或不受控制的运动的结果。这些运动使某些原子成为良好的电导体。具有这种类型原子的材料在其外壳或轨道中具有许多自由电子。

相比之下,绝缘材料的自由电子数量相对较少。因此,绝缘体的外壳电子往往会牢牢地保持其位置,几乎不允许任何电流流过它。因此,在绝缘材料中,很少发生导电性。

*半导体*

在导体和绝缘体之间,还有第三类原子(材料),称为半导体。一般来说,半导体的电导率介于金属和绝缘体

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Layout XL 生成和编辑布局


使用 Layout XL 生成和编辑布局

该材料由 Steven Levitan 于 2008 年秋季在匹兹堡大学为环境而编写。

我们使用的是 NCSU 1.6 Beta CDK 和 Virtuoso 1.6.1.2

有关背景信息,请查阅 NCSU EDA Wiki

非常感谢 NCSU 团队的辛勤工作!

请参阅我们 关于设置设计环境和运行 Virtuoso 的教程

从现有原理图开始

  • 启动 Cadence 设计框架 (virtuoso)
  • 使用 virtuoso 创建和模拟 2 输入 NAND 门原理图(在库 Lab1 中称为 NAND2)
  • 对模拟感到满意后,关闭 ADE 模拟窗口

创建一

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